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@Golem

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  1. @Golem

    Autor: don.redhorse 07.03.17 - 18:33

    "Von den 128 PCIe-Gen3-Lanes, die zwei Naples-Chips aufweisen, wird allerdings die Hälfte verwendet, um die beiden Prozessoren in einem 2-Sockel-System über je 64 Bahnen per erweitertem Hypertransport miteinander kommunizieren zu lassen."

    hat nicht jede Naples CPU 128 PCI-Gen3-Lanes? Also zweimal 128 Lanes, minus je 64 für den Interconnect, macht immer noch zwei mal 64 sprich 128 Lanes für i.O.?

  2. Re: @Golem

    Autor: ms (Golem.de) 07.03.17 - 18:44

    Das stimmt, ist schlecht formuliert - ich ändere es. Danke!

    Mit freundlichen Grüßen
    Marc Sauter
    Golem.de

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